Verilogは見た目がC言語っぽいだけで実際にはbitやメモリ、計算リソースをガチガチに意識して書く。これを高級言語と呼ぶのは新人君を引き込む常套句。ぜひ皆さんもこれにすっかり騙されてHW設計の沼に入ってほしい。

RySa のブックマーク 2024/02/24 19:36

<blockquote class="hatena-bookmark-comment"><a class="comment-info" href="https://b.hatena.ne.jp/entry/4749663232720324192/comment/RySa" data-user-id="RySa" data-entry-url="https://b.hatena.ne.jp/entry/s/ascii.jp/elem/000/004/185/4185502/" data-original-href="https://ascii.jp/elem/000/004/185/4185502/" data-entry-favicon="https://cdn-ak2.favicon.st-hatena.com/64?url=https%3A%2F%2Fascii.jp%2Felem%2F000%2F004%2F185%2F4185502%2F" data-user-icon="/users/RySa/profile.png">え、高級言語しか触ったことないのにCPUを自作するんですか!?</a><br><p style="clear: left">Verilogは見た目がC言語っぽいだけで実際にはbitやメモリ、計算リソースをガチガチに意識して書く。これを高級言語と呼ぶのは新人君を引き込む常套句。ぜひ皆さんもこれにすっかり騙されてHW設計の沼に入ってほしい。</p><a class="datetime" href="https://b.hatena.ne.jp/RySa/20240224#bookmark-4749663232720324192"><span class="datetime-body">2024/02/24 19:36</span></a></blockquote><script src="https://b.st-hatena.com/js/comment-widget.js" charset="utf-8" async></script>

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え、高級言語しか触ったことないのにCPUを自作するんですか!?

ascii.jp2024/02/22

今回は、高専5年次から趣味で学習していたRISC-Vを実装した、簡単なCPU作成をしていこうと思います。完全に知識ゼロの状態から学び始めたので、間違った解釈をしている部分があるかもしれませんが、その時は優し...

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