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    turanukimaru
    turanukimaru Verilog のヤバいところはモジュール内部ではなくin out wire, モジュール間通信だったと記憶してるのだが私の勉強法が悪かったのかもしれない。

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    Iridium
    Iridium 何も知らないが、高級言語に最適化したCPUというのも存在できるのでは。

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    Kmusiclife
    Kmusiclife え、バイナリでかけないのですか?01で読めないと生きてけないですよ?と言っとくテスト笑

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    irimo
    irimo 初手高級言語ですね…(半田付け苦手勢)

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    RySa
    RySa Verilogは見た目がC言語っぽいだけで実際にはbitやメモリ、計算リソースをガチガチに意識して書く。これを高級言語と呼ぶのは新人君を引き込む常套句。ぜひ皆さんもこれにすっかり騙されてHW設計の沼に入ってほしい。

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    gcyn
    gcyn 『最近はRISC-VとHTTPを勉強中』

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    aramaaaa
    aramaaaa 70年代にマシン語から始めたけど、それとCPUのアーキテクチャを考えるのは別のような。ただ基本外部からの読み書きと一時記憶と加減算と条件分岐ができればよいはず

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    shodai
    shodai “SystemVerilogを用いることで、プログラミング言語を扱うかのように、コードによってハードウェアを作成することができます!凄いですね。”

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    qpci32siekqd
    qpci32siekqd 自作CPUでALUとコンパイラは出来るけど、PLL、高速IFのPHY、レイアウト、DFTあたりで詰むんだよね。次が多電源。

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    atsushieno
    atsushieno 「えっ、C++しか書いたことないのにネイティブコード生成の最適化実装やってるんですか?」とか言い出したら「バカかな?」ってなるけど、CPUの世界ではそういう言説が容認されるのかしら。会社の問題? / Chiselとかある

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    moritata
    moritata “に知識ゼロの状態から学び始めたので、間違っ”

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    え、高級言語しか触ったことないのにCPUを自作するんですか!?

    今回は、高専5年次から趣味で学習していたRISC-Vを実装した、簡単なCPU作成をしていこうと思います。 完...

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    • Gewalt2024/02/27 Gewalt
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