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記事へのコメント32件
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shioki
"メモリチップの三次元積層とシリコン貫通電極 (TSV, Through-Sillicon Via)、メモリコントローラの統合など新技術・新アーキテクチャを採用することで、現行のDDR3と比較して大幅な高速化と低消費電力、実装面積の削減を可能"
kotaponx
増設はパススルーリンクを通してチップをデイジーチェーンするのか。DRAMコントローラをメモリ側に持つということは、SoCやCPU側の改変も必須だね。TSVは熱が心配ではあるけど。特許やIPまわりはどうなんだろ?
rishida
「メモリの壁」を破る次世代DRAM規格 HMC (ハイブリッドメモリキューブ)、1.0仕様公開 - Engadget Japanese 「メモリの壁」を破る次世代DRAM規格 HMC (ハイブリッドメモリキューブ)、1.0仕様公開 By Ittousai posted 2013年04月03日 21時08分 0
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2013/04/04 リンク