行列行列積の高速化手法 - Qiita
本記事では、行列行列積に焦点を当てて、高速化を行う上で重要な事項に関して、既存の資料よりもできるだけわかりやすく説明することを心がけて記載する。 アーキテクチャの詳細など細かい技術的なことが知りたい人はHPCで検索すれば溢れかえるほどの資料が出てくるはずなので、ここでは言及しない。 *内容が間違っている場合は指摘いただけると嬉しいです。 追記：ループアンローリングでは、最外側のループからアンロールを行なった方が高速なので、プログラムを変更しました。 #序論 コンピュータの高速化を行う際にどのような計算に対して高速な処理を行うのかというのは、いろいろな議論が起こっている。 TOP500は世界のコンピュータの中で高速なコンピュータの上位500位までをランク付けするもので、年に2回行われている。 かつて、日本の富士通が開発したK computerが世界1位を取ったということでニュースになったのも
COOL Chips 20 - 基調講演で語られた世界一のスパコン「太湖之光」(5) 世界一のスパコン「神威 太湖之光」のアプリケーション開発状況
Sunway TaihuLightのアプリケーション開発 Top500で1位の新しいスパコンが出来ると、それを使った大規模計算が行われ、その論文がGordon Bell賞を狙って投稿されるのが常である。TaihuLightの前に、中国は天河2号でTop500の1位になったのであるが、中国からGordon Bell賞候補の論文は出て来ず、中国の大規模アプリケーション開発の遅れを印象付けることになってしまった。 これに対して2016年6月のISC16でTaihuLightがTop500で1位になり、2016年11月のSC16では、6件のGordon Bell賞最終候補の内の半分の3件がTaihuLightを使った大規模計算の論文となり、その内の気象計算の論文がGordon Bell賞を受賞した。 この成果は、中国がアプリケーション開発でも急速に力を付け、世界のトップレベルに並んできたことを強く
COOL Chips 20 - 富士通の12世代目となるSPARC64 XIIプロセサ
横浜にて開催されたIEEE主催のプロセサ関係の国際会議「COOL Chips 20」において、富士通は第12世代目となるプロセサ「SPARC64 XII」を発表した。ポスト京のスーパーコンピュータ(スパコン)では、プロセサはARM v8アーキテクチャに変更することが発表されているが、ビジネスサーバではSPARCアーキテクチャを引き続き使っていくことを明らかにした形である。 このところ、SPARC64やポスト京プロセサの学会発表について富士通では、吉田利雄氏や清水俊幸氏が行うことが多かったが、今回は、丸山拓巳氏の久々の登場である。 SPARC64 XIIプロセサの発表で目を引くのは、12コアという点である。番号順でいうと直前となるSPARC64 XIfxは32個のプロセサコアと2個のアシスタントコアを搭載する34コアプロセサチップであったが、今回のSPARC64 XIIでは、ほぼ1/3の12
COOL Chips 20 - 基調講演で語られた世界一のスパコン「太湖之光」(1) 世界一のスパコン「神威 太湖之光」はなにが凄いのか?
横浜にて開催されたIEEE主催のプロセサ関係の国際会議「COOL Chips 20」において、中国の無錫スーパーコンピューティングセンター(National Supercomputing Center in Wuxi)のHaohuan Fu氏が、Top500 1位の「神威 太湖之光(Sunway TaihuLight)スパコン」に関する基調講演を行った。 太湖之光システムについては、Top500の1位として華々しく登場した2016年6月のISC、Gordon Bell賞を獲得した2016年11月のSCでも発表が行われたが、今回のCOOL Chipsでの発表は、多くの新しい情報が含まれた興味深いものであった。 次の中国の地図で右端に近い河口に面しているのが上海で、そこからほど近い大きな湖が太湖で、その太湖のほとりにあるのが無錫市である。 Sunway TaihuLightは、太湖のほとりにあ
HMM (Heterogeneous Memory Management) v20
Patchset is on top of mmotm mmotm-2017-04-18 and Michal patchset ([PATCH -v3 0/13] mm: make movable onlining suck less). Branch: https://cgit.freedesktop.org/~glisse/linux/log/?h=hmm-v20 I have included all suggestion made since v19, it is all build fix and change in respect to memory hotplug with Michal rework. Changes since v19: - Included various build fix and compilation warning fix - Limit HM
「AIスパコンの性能を3年半で1000倍に」、東工大の松岡教授
「まだ予算はついていないが、2019年前半にも人工知能（AI）の処理を1Exa FLOPSで実行できるスパコンは実現可能」。東京工業大学 教授の松岡聡氏は、インテルが2017年4月6日に開いた「インテルAI Day」に登壇し、人工知能（AI）やビッグデータ処理に向くスーパーコンピューターの開発状況を解説した（図1）。同氏は、2017年夏に稼働を始める東京工業大学の「TSUBAME3.0」（関連記事）や、2018年3月ごろの実動を目指す「AI橋渡しクラウド（ABCI：AI Bridging Cloud Infrastructure）」（関連記事）で、AIやビッグデータ処理を高速化できるアーキテクチャーの実装を進めている。 同氏はまず、AIやビッグデータ処理の計算特性は、従来のスパコンの主な用途だったシミュレーションなどと比べて本質的な違いはないが、修正すべき点もあると指摘した（図2）。その１
Personalized Aesthetics: Recording the Visual Mind using Machine Learning | NVIDIA Technical Blog
Personalized Aesthetics: Recording the Visual Mind using Machine Learning Visual aesthetics are very personal, often subconscious, and hard to express. In a world with an overload of photographic content, a lot of time and effort is spent manually curating photographs, and it’s often hard to separate the good images from the visual noise. The question we put forward at EyeEm is: can a machine lea
NEC、独アーヘン工科大にスカラ型スパコン「LXシリーズ」を納入
NECとNECドイツは3月17日、ドイツの大学支援プログラムであるエクセレンス・イニシアティブに指定された11大学の1つであり、工学と自然科学を結び付ける独自のアプローチを行う欧州有数の大学である独アーヘン工科大学のITセンターにスカラ型スーパーコンピュータ(スパコン)であるHPCサーバ「LXシリーズ」を納入したことを発表した。 LXシリーズは、Intel Xeon E5-2600 v4製品ファミリ搭載のデュアルソケットMPIコンピュートノードと、大容量メモリを搭載したSMPノードで構成される750超のノードで構成され、トータル1万9000超のコアで600TFlopsの処理性能を提供する。また、ノード間はIntelの高速インタコネクトである「Intel Omni-Path Architecture」で接続され、同大の研究者の演算能力に対するニーズに合わせる形で、システムの継続的な拡大を可能
Hisa Andoのディープラーニング挑戦記(6) DIGITSの画像分類を実行してみる
最後は学習の実行 学習が実行されると、次の図のような出力が画面に表示される。横軸はエポックであり、縦軸は左がロス(正解と比較した誤差)、右が精度(Accuracy)である。右下がりの2本のグラフはロス(誤差)で、青線が訓練時のロス、赤線が検証データを認識した時のロスである。そして、緑の線は検証データセットを認識させて検証した精度である。当然であるが、学習に使用するデータのロスを小さくするように学習するので、青線のロスは小さくなる。一方、学習には使っていない検証データのロスは、それよりも多くなるが、4～5エポック目までは順調に減少している。 そして、認識精度は4エポック目には96%程度に達し、それ以降はフラットで改善は見られないということになっている。 MNIST_smallモデルの学習過程の表示。検証データセットのロスが減少すれば学習が進んでいる。緑のAccuracyは検証データの認識精度
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dCUDA: Distributed GPU Computing with Hardware Overlap - High-Performance Computing News Analysis | insideHPC
【後藤弘茂のWeekly海外ニュース】 世界最速スパコン中国「神威太湖之光」のCPU「SW26010」の概要 ～PS3の「Cell B.E.」と似た設計
Intel Xeon Phi Cluster Mode Programming (and interactions with memory modes) in a Nutshell - High-Performance Computing News Analysis | insideHPC
» エクサスケールを目指す新たな日本のスパコン・プロジェクト
Intel Xeon Phi Memory Mode Programming (MCDRAM) in a Nutshell - High-Performance Computing News Analysis | insideHPC
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Amazon.co.jp: 計算科学のためのHPC技術2: 下司雅章 (編集), 南一生 (その他), 高橋大介 (その他), 尾崎泰助 (その他), 安藤嘉倫 (その他), 小林正人 (その他), 成瀬彰 (その他), 黒澤一平 (その他): 本
